FDUMA共有メモリ・アーキテクチャにおけるバス・アービトレーション

URI http://harp.lib.hiroshima-u.ac.jp/hiroshima-cu/metadata/6730
File
Title
FDUMA共有メモリ・アーキテクチャにおけるバス・アービトレーション
Title Alternative
Bus Arbitration for FDUMA Shared Memory Architecture
Author
氏名 森垣 利彦
ヨミ モリガキ トシヒコ
別名 MORIGAKI Toshihiko
氏名 弘中 哲夫
ヨミ ヒロナカ テツオ
別名 HIRONAKA Tetsuo
氏名 児島 彰
ヨミ コジマ アキラ
別名 KOJIMA Akira
氏名 藤野 清次
ヨミ フジノ セイジ
別名 FUJINO Seiji
Abstract

近年, プロセッサとDRAMを1つのLSI上に混載することでメモリバンド幅を広げる研究が行われている. しかし, この方法ではベクトル処理的な用途以外では得られるメモリバンド幅を有効に活用できず, On Chip Multiprocessorなどの共有メモリとして利用しにくい. そこで我々はこの問題を解決するメモリ・アーキテクチャとして, FDUMAマルチポートメモリシステムを提案している. 本稿では, 現在開発中であるFDUMAメモリシステムの試作機で用いるバス・アービトレーションについて述べ, その後ソフトウェア・シミュレータによるFDUMAメモリシステムの特性評価を行う. / Many research are done on deriving high memory bandwidth by merging the DRAM and logic on one chip. This merged DRAM/logic chip is effective for vector-style processing. Although it is not suitable for shared memory archtecture like the On Chip Multiprocessor. We proposes an memory archtecture, FDUMA Multiport Memory System, to solve the problem. This paper describes the method of bus arbitrations, that we use to impliment the prototype FDUMA Memory System. The results of performance evaluation done by software simulation are also presented.

Journal Title
情報処理学会研究報告. 計算機アーキテクチャ研究会報告
Volume
97
Issue
76
Spage
91
Epage
96
Published Date
1997-08-20
Publisher
社団法人情報処理学会
ISSN
0919-6072
NCID
AN10096105
NAID
110002774714
Language
jpn
NIIType
Technical Report
Text Version
出版社版
Rights
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hiroshima-cu